<!DOCTYPE html PUBLIC "-//W3C//DTD HTML 4.01 Transitional//EN">
<html>
<head>
  <meta content="text/html;charset=ISO-8859-1" http-equiv="Content-Type">
</head>
<body bgcolor="#ffffff" text="#000000">
Andy Fleming schrieb:
<blockquote
 cite="mid:2acbd3e40804010725w62947a2eofc20ec7b6dc77459@mail.gmail.com"
 type="cite">
  <pre wrap="">On Tue, Apr 1, 2008 at 9:08 AM, Andre Schwarz
<a class="moz-txt-link-rfc2396E" href="mailto:andre.schwarz@matrix-vision.de">&lt;andre.schwarz@matrix-vision.de&gt;</a> wrote:
  </pre>
  <blockquote type="cite">
    <pre wrap="">
 Tor,

 after investigating the tsec code I'm wondering how your PHY works in
 RGMII mode ...

 I think that there are some things missing, e.g. taking RGMII into
 account during tsec_init.

 /* Init ECNTRL */
 regs-&gt;ecntrl = ECNTRL_INIT_SETTINGS;

 If you look carefully, you'll notice that ecntrl's RPM bit is
read-only. Those bits are configured by POR pin strappings.


 sorry, my documentation (MPC8349EARM rev.1) declares this register
read-write.
 Of course it will be configured by the HRCW but can be overwritten
afterwards.

 If this is not true it's a documentation bug.
    </pre>
  </blockquote>
  <pre wrap=""><!---->

Thank you for bringing this to my attention.  It is almost certainly a
bug.  If you look at the 8349ERM (rather than the 8349EARM), you'll
see that the bits are read-only (except for R100, which tsec.c does
modify based on the link type).  I will file a bug with the docs
people.


  </pre>
</blockquote>
I've x-checked and printed the register after init.<br>
You're right - it's read only and the RPM bit is set.<br>
But the ECNTL&nbsp; register description @ 15.5.3.1.4 says "read/write" to
all bits ...<br>
<blockquote
 cite="mid:2acbd3e40804010725w62947a2eofc20ec7b6dc77459@mail.gmail.com"
 type="cite">
  <pre wrap=""></pre>
  <blockquote type="cite">
    <pre wrap="">
 You may be more familiar with the UEC, which doesn't automatically
detect the link type, but is otherwise fairly similar to the tsec.


 What do you mean ?
 I'm trying to get two VSC8601 RGMII PHYs running on a MPC8343B ...
    </pre>
  </blockquote>
  <pre wrap=""><!---->
sorry, I forgot which ethernet controller you were using, and I'm not
as familiar with the 83xx family as the 85xx family.  Some of our
parts have the QUICC Engine, which has an ethernet controller with
some similar registers to the TSEC's.  I was guessing that was why you
thought those bits were writable, rather than a documentation bug, but
clearly I was wrong.  :)

  </pre>
</blockquote>
no problem.<br>
<br>
Andre<br>
<blockquote
 cite="mid:2acbd3e40804010725w62947a2eofc20ec7b6dc77459@mail.gmail.com"
 type="cite">
  <pre wrap="">Andy

Andy
  </pre>
</blockquote>
<br>
<BR>

MATRIX VISION GmbH, Talstraße 16, DE-71570 Oppenweiler  - Registergericht: Amtsgericht Stuttgart, HRB 271090
Geschäftsführer: Gerhard Thullner, Werner Armingeon, Uwe Furtner
<BR>
</body>
</html>